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https://github.com/PabloMK7/citra.git
synced 2024-11-16 12:03:25 +01:00
commit
a968adf50e
@ -1357,6 +1357,12 @@ mainswitch:
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break;
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break;
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case 0x04: /* SUB reg */
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case 0x04: /* SUB reg */
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// Signifies UMAAL
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if (state->is_v6 && BITS(4, 7) == 0x09) {
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if (handle_v6_insn(state, instr))
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break;
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}
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#ifdef MODET
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#ifdef MODET
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if (BITS (4, 7) == 0xB) {
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if (BITS (4, 7) == 0xB) {
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/* STRH immediate offset, no write-back, down, post indexed. */
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/* STRH immediate offset, no write-back, down, post indexed. */
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@ -5683,8 +5689,24 @@ L_stm_s_takeabort:
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case 0x03:
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case 0x03:
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printf ("Unhandled v6 insn: ldr\n");
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printf ("Unhandled v6 insn: ldr\n");
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break;
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break;
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case 0x04:
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case 0x04: // UMAAL
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printf ("Unhandled v6 insn: umaal\n");
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{
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const u8 rm_idx = BITS(8, 11);
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const u8 rn_idx = BITS(0, 3);
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const u8 rd_lo_idx = BITS(12, 15);
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const u8 rd_hi_idx = BITS(16, 19);
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const u32 rm_val = state->Reg[rm_idx];
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const u32 rn_val = state->Reg[rn_idx];
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const u32 rd_lo_val = state->Reg[rd_lo_idx];
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const u32 rd_hi_val = state->Reg[rd_hi_idx];
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const u64 result = (rn_val * rm_val) + rd_lo_val + rd_hi_val;
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state->Reg[rd_lo_idx] = (result & 0xFFFFFFFF);
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state->Reg[rd_hi_idx] = ((result >> 32) & 0xFFFFFFFF);
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return 1;
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}
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break;
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break;
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case 0x06:
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case 0x06:
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printf ("Unhandled v6 insn: mls/str\n");
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printf ("Unhandled v6 insn: mls/str\n");
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